基于CPLD的容错存储器的设计实现
作者：全球MRO综合服务商 仪器仪表技术文章来源：全球MRO仪器仪表交易网 点击数： 更新时间：2006-10-11
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增益G=4.6～9．3。通过CPLD来实现存储器的容错，大大缩短了设计开发周期，降低了成本，同时提高了系统的可靠性。
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